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文檔簡介
數字電子技術知到智慧樹期末考試答案題庫2025年麗水學院集成邏輯門電路在使用時,一般不讓多余的輸入端懸空,以防引入干擾信號。對多余輸入端的處理以不改變電路工作狀態及穩定可靠為原則。()
答案:對邏輯表達式A+BC=()。
答案:(A+B)(A+C)邏輯函數式F=A(B+C),其反函數為()。
答案:邏輯函數式F=A(B+C),其反函數為()。計數器的應用有()。
答案:分頻;計數;定時;產生節拍脈沖觸發器的輸出邏輯電平從1到0或從0到1的轉換稱為()
答案:翻轉觸發器的兩個輸出處于下列哪個狀態時被稱為1狀態。()
答案:觸發器的兩個輸出處于下列哪個狀態時被稱為1狀態。()?觸發器有兩個穩定狀態,一個是現態,一個是次態。()?
答案:錯觸發器CLK輸入端的三角形符號指的是()
答案:邊沿觸發要把8421BCD轉換成余3碼,最簡單的方法是使用()。
答案:4位二進制加法器若輸入變量A,B全為1時,輸出F=0,則輸出與輸入的關系是什么運算。()
答案:或非;異或;與非?若兩個函數相等,則它們的真值表一定相同;反之,若兩個函數的真值表完全相同,則這兩個函數未必相等。()?
答案:錯若JK觸發器的原狀態為0,欲在CLK作用后仍保持為0狀態,則JK的值應是()。
答案:J=0,K=x組合邏輯電路的特點有哪些?()
答案:輸出和輸入之間沒有反饋通路;任一時刻的輸出狀態僅取決于該時刻輸入狀態,而和電路原來的狀態無關;無記憶元件?組合邏輯電路中的競爭冒險是由什么引起的。()
答案:門電路的延時移位寄存器只能串行輸出。()
答案:錯?相比TTL器件,以下是一些關于CMOS邏輯門的說法,不正確的是()。
答案:CMOS器件的噪聲容限較小用觸發器設計一個14進制計數器,所需觸發器的數目為()個。
答案:4用卡諾圖化簡一個邏輯函數,得到的最簡與或式可能不是唯一的。()
答案:對格雷碼中任意兩個相鄰數的代碼只有一位碼元不同。()
答案:對根據在CLK控制下,邏輯功能的不同,常把觸發器分為RS、D、JK、T、T’五類。()?
答案:對某電視機水平——垂直掃描發生器需要一個分頻器將31500Hz的脈沖轉換為60Hz的脈沖,構成此分頻器至少需要9個觸發器。()???
答案:錯有一個左移移位寄存器,當預先置入1011后,其串行輸入固定接0,在4個移位脈沖CP作用下,四位數據的移位過程是()
答案:1011—0110—1100—1000--0000有S1,S2兩個狀態,條件什么可確定S1和S2不等價。()
答案:輸出不同有10條地址線的半導體存儲芯片,若采用矩陣譯碼方式,則有幾條存儲單元選擇控制線。()
答案:1024時序邏輯電路中一定包含()
答案:觸發器描述時序邏輯電路邏輯關系的三大方程分別是()方程、輸出方程和狀態方程。
答案:驅動當輸入端S和R為何值時,由或非門構成的SR鎖存器保持原狀態不變。()
答案:S=0,R=0當輸入端S和R為何值時,由或非門構成的SR鎖存器會出現不穩定狀態。()
答案:S=1,R=1當一個邏輯門的兩個輸入端的信號同時向相反方向變化,而變化的時間有差異的現象,稱為競爭。由競爭而可能產生輸出干擾毛刺的現象稱為冒險。()?
答案:對常用集成觸發器有邊沿JK觸發器和維持阻塞D觸發器兩種。()?
答案:對帶符號二進制補碼01011001和11010011所表示的十進制數分別為()。
答案:89,–45?已知十進制數為92,其對應的余3碼為()。
答案:(11000101)余3碼已知Intel2114是1KХ4位的RAM集成電路芯片,它有地址線幾條,數據線幾條?()
答案:10;4將十六進制數(36.D)H轉換成十進制數是()
答案:54.8125?將二進制數1011.0101轉換成十六進制數為()。
答案:(B.5)16將二進制數(101101.11)B轉換成十進制數是()
答案:45.75?將二進制數(101001101100)B轉換成十六進制數是()
答案:A6C將Intel2114(1k*4位)RAM擴展成為16k*8位的存儲器,需要Intel2114芯片的片數以及需要增加的地址線條數分別為32片和4條。()
答案:對將75轉化為8421BCD碼為()。
答案:01110101將256×1位ROM擴展為1024×1位ROM,地址線為幾根。()
答案:10對于T觸發器,若原態Q=0,欲使新態Q*=1,應使輸入T為多少?()
答案:1完成二進制代碼轉換為十進制數的器件應選擇()。
答案:譯碼器如果要用JK觸發器來實現D觸發器的功能,則J=(),K=()。()
答案:D;D'多路數據分配器可以直接由什么來實現。()
答案:譯碼器基本RS觸發器具有“不定”問題()???
答案:對在圖示電路中,能完成Q*=Q’的邏輯功能的電路有()
答案:在圖示電路中,能完成Q*=Q’的邏輯功能的電路有()在下圖所示電路中,能完成T觸發器邏輯功能的電路有()
答案:在下圖所示電路中,能完成T觸發器邏輯功能的電路有()在下列邏輯部件中,屬于組合邏輯部件的是()
答案:編碼器;全加器?四個邏輯相鄰的最小項合并,可以消去多少對因子?()
答案:2同步計數器和異步計數器比較,同步計數器的顯著優點是工作速度快。()
答案:對同步時序電路的工作速度高于異步時序電路。()
答案:對?同步時序電路和異步時序電路的最主要區別是,前者沒有CLK脈沖,后者有CLK脈沖。()??
答案:錯同步時序電路中觸發器的數目為N,狀態數為M,則兩者的關系為()。
答案:同步時序電路中觸發器的數目為N,狀態數為M,則兩者的關系為()。可以用來實現并/串轉換和串/并轉換的器件是()
答案:移位寄存器只讀存儲器ROM的功能是什么?()
答案:只能讀出存儲器的內容且斷電后仍保持卡諾圖上變量的取值順序是采用什么形式,以便能夠用幾何上的相鄰關系表示邏輯上的相鄰。()
答案:循環碼?十進制數–10的8位帶符號二進制數的原碼及補碼表示分別是()
答案:10001010,11110110十進制數–25的8位二進制補碼表示為(11100111)B,對嗎?()
答案:對功耗是門電路重要參數之一。功耗有靜態和動態之分。所謂靜態功耗是指電路輸出沒有狀態轉換時的功耗。而電路在輸出發生狀態轉換時的功耗稱為動態功耗。()
答案:對利用ROM實現四位二進制碼到四位格雷碼的轉換,則該ROM的數據線有4根,地址線有幾根。()
答案:4利用ROM實現兩個4位二進制數相乘的功能,則該ROM的地址線有幾根。()
答案:8具有記憶功能的邏輯電路是()。
答案:計數器全減器有()個輸入,()個輸出。()
答案:3,2什么電路在任何時刻只能有一個輸出端有效。()
答案:二進制譯碼器五個D觸發器構成基本環形計數器,其有效循環狀態數為()。
答案:5二進制數1011.0101轉換成十進制數為()。
答案:11.3125為避免一次翻轉現象,應采用什么觸發器?()
答案:邊沿?為了防止邏輯門損壞,所有邏輯門的輸出都不允許用線直接相連。()
答案:錯串行進位加法器的缺點是運算速度慢,優點是電路結構簡單。超前進位加法器的優點是運算速度快,缺點是電路結構復雜。()
答案:對下面所列的各觸發器,能夠組成移位寄存器的有()。
答案:邊沿觸發器;主從結構觸發器下面哪項不是三態門的主要用途()
答案:電平轉換下列觸發器中,有空翻現象的是()
答案:電平RS觸發器下列等式成立的是()
答案:下列等式成立的是()下列哪些CMOS門可以將輸出端并接使用?()
答案:三態(TS)輸出;漏極開路(OD)輸出下列幾種說法中錯誤的是()
答案:卡諾圖中1的個數和0的個數相同。三態門的輸出狀態有()。
答案:高阻態;低電平;高電平三個D觸發器構成模8的同步二進制加法計數器的初態為101,經2016個時鐘后,計數器狀態為多少?()
答案:101七段數碼顯示譯碼電路應有幾個輸出端。()
答案:7個一個譯碼器若有100個譯碼輸出端,則譯碼器地址輸入端至少有多少個。()
答案:7一個觸發器能夠記憶“0”和“1”兩種狀態。()?
答案:對一個容量為1024×2的靜態RAM具有()。
答案:地址線10根,數據線2根一個存儲矩陣有64行、64列,則存儲陣列的存儲容量為多少個存儲單元。()
答案:4K一個十六路數據選擇器,其地址輸入端有()個。
答案:4一個具有n根地址輸入線和k條輸出線的ROM存儲容量是()
答案:一個具有n根地址輸入線和k條輸出線的ROM存儲容量是()一個八選一數據選擇器,其地址輸入端有多少個。()
答案:3一個16K×4的存儲系統的起始地址為全0,其最高地址的十六進制地址碼為3FFFH。()?
答案:對RS觸發器、JK觸發器均具有狀態翻轉功能。()?
答案:錯ROM的邏輯結構可以看成一個與門陣列和一個或門陣列的組合。()?
答案:對?n個變量,有多少個最小項()
答案:?n個變量,有多少個最小項()?F(A,B,C)的兩個最小項之積=()。
答案:0CMOS門電路的輸入端在使用中不允許懸空。()
答案:對CMOS門電路多余輸入端應該()。
答案:與其他輸入端并接?8位無符號二進制數(11111111)B所對應的十進制數是()。
答案:255?8位二進制補碼所表示的數值范圍為–256~+255。()?
答案:錯?5、對主從結構的JK觸發器,在CLK為高電平期間,當J=K=1時,狀態只會翻轉一次。()
答案:對?4、指出下圖所示電路中,能正常工作的有()。
答案:?4、指出下圖所示電路中,能正常工作的有()。?132、對于一個帶符號的二進制數,其最高位表示符號位,其余部分表示數值位,所以一個用補碼表示的4位帶符號二進制數1001表示的是十進制數–1。()?
答案:錯
答案:對
答案:高電平
答案:
答案:不能同時為1
答案:
答案:1,1
答案:2線-4線譯碼器
答案:
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