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邊沿觸發(fā)器為了提高觸發(fā)器的抗干擾能力,希望觸發(fā)器的次態(tài)僅僅取決于CP信號的沿(上升沿和下降沿)到達(dá)時(shí)刻輸入信號的狀態(tài),而在此之前和之后輸入狀態(tài)的變化對次態(tài)沒有影響。維持-阻塞邊沿D觸發(fā)器CMOS主從結(jié)構(gòu)邊沿觸發(fā)器利用傳輸延遲時(shí)間的邊沿觸發(fā)器1§5.3.1維持—阻塞邊沿D觸發(fā)器置1維持線置0維持線&&&&Q&&QCPSRG1G2G3G4G5G6S’R’置0阻塞線置1阻塞線0102§5.3.1維持—阻塞邊沿D觸發(fā)器單端輸入置1維持線置0維持線&&&&Q&&QCPRG1G2G3G4G5G6S’R’置0阻塞線D置1阻塞線3§5.3.1維持—阻塞邊沿D觸發(fā)器電路圖符號QQC11DRSSDRDCPD國標(biāo)符號國標(biāo)符號“>”表示單元觸發(fā)動作4DQn+100011011Qn0激勵(lì)表101§5.3.1維持—阻塞邊沿D觸發(fā)器特性方程(狀態(tài)方程)與狀態(tài)表狀態(tài)轉(zhuǎn)移圖與激勵(lì)表DQn+1狀態(tài)表0110CP
5§5.3.1維持—阻塞邊沿D觸發(fā)器動態(tài)特性建立時(shí)間保持時(shí)間傳輸延遲最高時(shí)鐘頻率6§5.3.1維持—阻塞邊沿D觸發(fā)器動態(tài)特性建立時(shí)間電路特點(diǎn):CP是加在G3和G4上的;
CP
到達(dá)前,G5和G6的輸出必須穩(wěn)定地建立;
D端的輸入信號必須先于CP的上升沿到達(dá);
7§5.3.1維持—阻塞邊沿D觸發(fā)器動態(tài)特性保持時(shí)間為了實(shí)現(xiàn)邊沿觸發(fā),應(yīng)保證CP=1期間G6的輸出始終不變;或者使G6的變化受到輸入控制門的封鎖。考慮阻塞線置1阻塞置0阻塞0111018§5.3.2CMOS主從結(jié)構(gòu)邊沿觸發(fā)器電路結(jié)構(gòu)CP=0時(shí),TG1接通,TG2關(guān)閉,主觸發(fā)器接收輸入信號,Q’=D;CP=0時(shí),TG4接通,TG3關(guān)閉,輸出維持不變(從)。當(dāng)CP從0變成1,上升沿……9§5.3.2CMOS主從結(jié)構(gòu)邊沿觸發(fā)器CP由0變1時(shí),TG1關(guān)閉,TG2接通,G1門輸入端電容存儲,被切斷前!Q’的狀態(tài)被主觸發(fā)器保存;CP=1,TG3接通,TG4關(guān)閉,輸出維持不變(主)。上升沿觸發(fā),即“輸入輸出復(fù)合”;但“主從復(fù)合”在上升沿。改變CP信號極性,可構(gòu)成下降沿觸發(fā)。電路結(jié)構(gòu)(全)CP=0時(shí),TG1接通,TG2關(guān)閉,主觸發(fā)器接收輸入信號,Q’=D;CP=0時(shí),TG4接通,TG3關(guān)閉,輸出維持不變(從)。10§5.3.3利用傳輸延遲時(shí)間的邊沿觸發(fā)器電路結(jié)構(gòu)G1、G2組成基本RS觸發(fā)器,G3、G4為導(dǎo)引門,其延遲時(shí)間大于基本RS觸發(fā)器翻轉(zhuǎn)時(shí)間。注意B和B’門。11§5.3.3利用傳輸延遲時(shí)間的邊沿觸發(fā)器CP=1期間:12§5.3.3利用傳輸延遲時(shí)間的邊沿觸發(fā)器CP由1變0時(shí),首先封鎖B、B’兩個(gè)與門,基本RS觸發(fā)器等效為:由于延遲時(shí)間大,CP下跳時(shí),G3、G4門的輸出還沒有變化,由基本RS觸發(fā)器特性方程:此后,G3、G4門也被封鎖,J、K的變化不再起作用。CP下降沿觸發(fā)。PP’13討論電平觸發(fā)v.s.主從觸發(fā)v.s.JK主從v.s.
邊沿觸發(fā)電平觸發(fā)多次翻轉(zhuǎn);主從觸發(fā)從觸發(fā)器的狀態(tài)不會多次翻轉(zhuǎn),輸出狀態(tài)在一個(gè)時(shí)鐘周期(相位從下降沿開始)內(nèi)穩(wěn)定不變;主觸發(fā)器仍可能多次翻轉(zhuǎn);主從JK觸發(fā)一次性改變:一個(gè)CP內(nèi)主觸發(fā)器可以改變一次,也只能改變一次;邊沿觸發(fā)——為了提高觸發(fā)器的可靠性,增強(qiáng)抗干擾能力,希望觸發(fā)器的次態(tài)僅僅取決于CP信號下降沿(或上升沿)到達(dá)時(shí)刻輸入信號的狀態(tài);在此之前和之后,輸入信號的變化對觸發(fā)器的次態(tài)沒有影響。14討論動態(tài)特性(回顧)基本RS同步RS主從JK維阻D
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