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成績(jī)：實(shí) 驗(yàn) 報(bào) 告課程名稱：20實(shí)驗(yàn)項(xiàng)目：2-4地址譯碼器實(shí)驗(yàn)姓 名：吳雅惠專 業(yè)：計(jì)算機(jī)科學(xué)與技術(shù)班 級(jí)：3學(xué) 號(hào)：1504010320計(jì)算機(jī)科學(xué)與技術(shù)學(xué)院實(shí)驗(yàn)教學(xué)中心2016 年 6 月 21 日2 / 4文檔可自由編輯打印一、. 實(shí)驗(yàn)?zāi)康模赫莆兆g碼器設(shè)計(jì)方法和原理，加深對(duì)中大規(guī)模集成電路的理解。二、實(shí)驗(yàn)內(nèi)容： 設(shè)計(jì)一個(gè)具有使能端的24 譯碼器，并用Verlog HDL條件運(yùn)算符描述。 譯碼器邏輯功能描述： 可分別用邏輯圖、函數(shù)式和真值表來描述，這里用函數(shù)式說明:。三、實(shí)驗(yàn)步驟: 在D盤上建一個(gè)子目錄。打開Quartus 后，點(diǎn)擊filsNew Projcct Wizard對(duì)話框，建立工程名。 選擇仿真器件，器件類型選擇FLEX10K，具體芯片選擇EPF10K10tc144-4 點(diǎn)擊filsNew ，雙擊Block Diagram/Schematic File建立圖形文件并編譯。 點(diǎn)擊filsNew ，雙擊Verilog HDL File建立文本文件并編譯。 點(diǎn)擊filsNew ，雙擊Vector Waveform File建立波形文件，分析仿真波形。 選擇Assignments Pins選擇綁定對(duì)應(yīng)元件管腳

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