基于FPGA的電路設計基于FPGA的電路設計主要內容FPGA的開發流程設計輸入仿真綜合布線布局燒寫開發實例編碼器輸出信號濾波編碼器輸出信號辨向、計數計數結果的數碼管掃描顯示主要內容FPGA的開發流程什么是FPGA/CPLD?PLDProgrammableLogicDevice可編程邏輯器件CPLD/FPGAComplexProgrammableLogicDevice復雜可編程邏輯器件FieldProgrammableGateArray現場可編程門陣列什么是FPGA/CPLD?PLD什么是FPGA/CPLD？什么是FPGA/CPLD？FPGA開發流程介紹及實例講解課件FPGA的內部結構籃色：邏輯陣列塊紅色：連線資源

黃色：輸入輸出控制塊FPGA的內部結構籃色：邏輯陣列塊紅色：連線資源黃色：輸入FPGA開發流程介紹及實例講解課件單片機與FPGA有何區別？在功能上，單片機與FPGA有很強的互補性單片機是程序流程控制。具有性能價格比高、功能靈活、易于人機對話以及良好的數據處理等特點FPGA是時序邏輯控制。FPGA具有高速、高可靠性以及開發便捷、規范等優點。對于復雜的設計任務，需將FPGA與單片機有機地結合在一起單片機負責鍵控、顯示、計算、通信、簡單控制和系統協調。FPGA負責高速、高精度和高穩定性等指標的實現。也就是說，由單片機負責功能上的設計，FPGA負責指標上的設計。

單片機與FPGA有何區別？在功能上，單片機與FPGA有很強的VHDL是什么？VHISC（VeryHighSpeedIntegratedCircuit）HardwareDescriptionLanguageVHDL:甚高速集成電路硬件描述語言VHDL是什么？VHISC（VeryHighFPGA開發環境介紹ACTEL公司LiberoIDEALTERA公司Max+plusIIQuartusIIXILINX公司XilinxISELATTICE公司ispLEVERFPGA開發環境介紹ACTEL公司LiberFPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件什么叫綜合？綜合是軟件描述與硬件實現的一座橋梁。綜合的功能：根據設計者在EDA平臺上完成的針對某個系統項目而采用的文本程序(VHDL)或原理圖，針對給定的硬件結構，進行編譯、優化、轉換和綜合，最終獲得電路描述文件。綜合的過程：將電路的高級語言描述轉換成低級的，可與FPGA/CPLD基本結構相映射的網表文件。什么叫綜合？綜合是軟件描述與硬件實現的一座橋梁。FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件濾波實際輸出波形分析：實際輸出脈沖波形所帶的毛刺實際是一些相對于正常脈沖周期來說很窄的跳變，這些跳變的電平狀態的持續時間很短。濾波濾波原理對任意輸入的帶毛刺信號，先檢測該信號的跳變沿，然后用一高頻時鐘信號對它將要保持的電平狀態進行計數。另外要設定一個毛刺的最大電平寬度，如認為寬度小于1μs的信號為毛刺，如果用8MHZ的時鐘信號計數8次，信號狀態不改變，就認為它是有用信號，并將它鎖存；否則為毛刺去掉。

濾波原理對任意輸入的帶毛刺信號，先檢測該信號的跳變沿，然后用濾波的具體實現AFZBFZABOCCLKCLRQFGAINOUTZCFFCFXZQQGNJSQbcclrclkZ圖3VHDL程序模塊結構連接圖濾波的具體實現ABACLKINOUTZCFFCFXZQQGN濾波效果濾波效果辨向、計數原理辨向、計數原理辨向的編程實現辨向的編程實現仿真結果仿真結果

THX！

1、有時候讀書是一種巧妙地避開思考的方法。12月-2212月-22Friday,December9,20222、閱讀一切好書如同和過去最杰出的人談話。17:05:3517:05:3517:0512/9/20225:05:35PM3、越是沒有本領的就越加自命不凡。12月-2217:05:3517:05Dec-2209-Dec-224、越是無能的人，越喜歡挑剔別人的錯兒。17:05:3517:05:3517:05Friday,December9,20225、知人者智，自知者明。勝人者有力，自勝者強。12月-2212月-2217:05:3517:05:35December9,20226、意志堅強的人能把世界放在手中像泥塊一樣任意揉捏。09十二月20225:05:35下午17:05:3512月-227、最具挑戰性的挑戰莫過于提升自我。。十二月225:05下午12月-2217:05December9,20228、業余生活要有意義，不要越軌。2022/12/917:05:3517:05:3509December20229、一個人即使已登上頂峰，也仍要自強不息。5:05:35下午5:05下午17:05:3512月-2210、你要做多大的事情，就該承受多大的壓力。12/9/20225:05:35PM17:05:3509-12月-2211、自己要先看得起自己，別人才會看得起你。12/9/20225:05PM12/9/20225:05PM12月-2212月-2212、這一秒不放棄，下一秒就會有希望。09-Dec-2209December202212月-2213、無論才能知識多么卓著，如果缺乏熱情，則無異紙上畫餅充饑，無補于事。Friday,December9,202209-Dec-2212月-2214、我只是自己不放過自己而已，現在我不會再逼自己眷戀了。12月-2217:05:3509December202217:05謝謝大家1、有時候讀書是一種巧妙地避開思考的方法。12月-2212月51基于FPGA的電路設計基于FPGA的電路設計主要內容FPGA的開發流程設計輸入仿真綜合布線布局燒寫開發實例編碼器輸出信號濾波編碼器輸出信號辨向、計數計數結果的數碼管掃描顯示主要內容FPGA的開發流程什么是FPGA/CPLD?PLDProgrammableLogicDevice可編程邏輯器件CPLD/FPGAComplexProgrammableLogicDevice復雜可編程邏輯器件FieldProgrammableGateArray現場可編程門陣列什么是FPGA/CPLD?PLD什么是FPGA/CPLD？什么是FPGA/CPLD？FPGA開發流程介紹及實例講解課件FPGA的內部結構籃色：邏輯陣列塊紅色：連線資源

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單片機與FPGA有何區別？在功能上，單片機與FPGA有很強的VHDL是什么？VHISC（VeryHighSpeedIntegratedCircuit）HardwareDescriptionLanguageVHDL:甚高速集成電路硬件描述語言VHDL是什么？VHISC（VeryHighFPGA開發環境介紹ACTEL公司LiberoIDEALTERA公司Max+plusIIQuartusIIXILINX公司XilinxISELATTICE公司ispLEVERFPGA開發環境介紹ACTEL公司LiberFPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件什么叫綜合？綜合是軟件描述與硬件實現的一座橋梁。綜合的功能：根據設計者在EDA平臺上完成的針對某個系統項目而采用的文本程序(VHDL)或原理圖，針對給定的硬件結構，進行編譯、優化、轉換和綜合，最終獲得電路描述文件。綜合的過程：將電路的高級語言描述轉換成低級的，可與FPGA/CPLD基本結構相映射的網表文件。什么叫綜合？綜合是軟件描述與硬件實現的一座橋梁。FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件FPGA開發流程介紹及實例講解課件濾波實際輸出波形分析：實際輸出脈沖波形所帶的毛刺實際是一些相對于正常脈沖周期來說很窄的跳變，這些跳變的電平狀態的持續時間很短。濾波濾波原理對任意輸入的帶毛刺信號，先檢測該信號的跳變沿，然后用一高頻時鐘信號對它將要保持的電平狀態進行計數。另外要設定一個毛刺的最大電平寬度，如認為寬度小于1μs的信號為毛刺，如果用8MHZ的時鐘信號計數8次，信號狀態不改變，就認為它是有用信號，并將它鎖存；否則為毛刺去掉。

濾波原理對任意輸入的帶毛刺信號，先檢測該信號的跳變沿，然后用濾波的具體實現AFZBFZABOCCLKCLRQFGAINOUTZCFFCFXZQQGNJSQbcclrclkZ圖3VHDL程序模塊結構連接圖濾波的具體實現ABACLKINOUTZCFFCFXZQQGN濾波效果濾波效果辨向、計數原理辨向、計數原理辨向的編程實現辨向的編程實現仿真結果仿真結果

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