1、基于FPGA的直接數(shù)字頻率合成技術(shù)設(shè)計       摘要：介紹了利用現(xiàn)場可編程邏輯門陣列FPGA實現(xiàn)直接數(shù)字頻率合成（DDS）的原理、電路結(jié)構(gòu)和優(yōu)化方法。重點介紹了DDS技術(shù)在FPGA中的實現(xiàn)方法，給出了采用ALTERA公司的ACEX系列FPGA芯片EP1K30TC進行直接數(shù)字頻率合成的VHDL源程序。    關(guān)鍵詞：直接數(shù)字頻率合成（DDS）；現(xiàn)場可編程邏輯門陣列（FPGA）；EP1K30TC-144直接數(shù)字頻率合成（ -?即，一般簡稱）是從相位概念出發(fā)直接合成所需波形的一種新的頻率合成技術(shù)。它在相對帶寬、頻率轉(zhuǎn)

2、換時間、相位連續(xù)性、正交輸出、高分辨率以及集成化等一系列性能指標(biāo)方面已遠遠超過了傳統(tǒng)頻率合成技術(shù)。當(dāng)累加器的很大時，最低輸出頻率可達、?甚至。也就是說：的最低合成頻率接近于零頻。如果為, 那么當(dāng)為位時，其分辨率可達。轉(zhuǎn)換時間最快可達的量級，這都是傳統(tǒng)頻率合成所不能比擬的。但它的不足之處是最高工作頻率會受限、噪聲和雜波不夠理想。本設(shè)計采用 公司的芯片來實現(xiàn)技術(shù)。芯片屬 公司的系列，該系列是公司著眼于通信、音頻處理及類似場合應(yīng)用而推出的器件系列芯片，它采用微米混合工藝，密度從門到門。所有系列器件均兼容、的，并支持鎖相環(huán)電路。 采用查找表（）和（嵌入式陣列塊）相結(jié)合的結(jié)構(gòu)，可用來實現(xiàn)存儲器、專用邏輯

3、功能和通用邏輯功能，每個能提供比特的存儲空間，每個包含個輸入、一個可編程的觸發(fā)器、進位鏈和一個層疊鏈。合理運用進位鏈能夠提高系統(tǒng)運行速度。的最大系統(tǒng)門數(shù)為，它有個邏輯宏單元數(shù)和個嵌入式陣列塊，最大可提供的位，因而可完全滿足設(shè)計的要求。的實現(xiàn)過程圖為系統(tǒng)的基本原理圖，圖中的相位累加器由位全加器和位累加寄存器級聯(lián)而成，可對頻率控制字的進制碼進行累加運算，是典型的反饋電路，產(chǎn)生的累加結(jié)果的高位作為查找表的取樣地址值，而此查找表中儲存了一個周期的正弦波幅度值。顯然，此處存儲器可以看作一個從相位到正弦幅值的轉(zhuǎn)換器。這樣，用的輸出值來驅(qū)動，然后經(jīng)濾波即可轉(zhuǎn)換成所需要的模擬正弦波形；同時位累加輸出又可作為全

4、加器的下一輪數(shù)據(jù)與頻率數(shù)據(jù)相加，直到相位累加器加滿產(chǎn)生溢出，從而完成一個周期，也就是信號的頻率周期。在中的實現(xiàn)考慮到本系統(tǒng)的規(guī)模以及以后的擴展需要，該系統(tǒng)中的電路采用硬件描述語言來實現(xiàn)，因為語言設(shè)計的電路模塊可以方便地移植到不同的芯片中。由于硬件原因，本系統(tǒng)的最高頻率為，因此，采用常規(guī)設(shè)計即可滿足要求，但若要應(yīng)用于高速系統(tǒng)，還要采用一些提高系統(tǒng)運行速度的措施，如采用流水線技術(shù)，即在設(shè)計中把延時較大的組合邏輯塊切割成兩塊大致相等的組合邏輯塊，并在這兩個邏輯塊中插入觸發(fā)器，也可通過多個觸發(fā)器時鐘來提高系統(tǒng)速度，還可以采用 公司的器件所特有的進位鏈來設(shè)計高速電路。   

5、 圖所示為一個具有頻率、相位與幅度調(diào)制的系統(tǒng)的組成框圖。它的頻率調(diào)制可以在調(diào)諧寄存器與相位累加器之間插入一加法器來實現(xiàn)，頻率調(diào)制與相位調(diào)制有相同的分辨率，因此，頻率可以覆蓋整個調(diào)諧頻段。相位調(diào)制器可通過在相位累加器后插入一個加法器來實現(xiàn)。幅度調(diào)制則是在正弦查找表后插入一個乘法器來實現(xiàn)。該系統(tǒng)具有高精度、高穩(wěn)定性等特點。 查找表的設(shè)計查找表在整個設(shè)計中是一個比較重要的部分。為了保證波形的平滑，設(shè)計時可將一個周期分為個點。但是，點數(shù)太多時，用文本方式輸入可能有很多困難。因此，應(yīng)當(dāng)用語言描述正弦方程式，最后再將其轉(zhuǎn)化為所需的文件。以下是其語言的源程序：() ; ;(;) (); 主模塊設(shè)計主模塊部分

6、可根據(jù)上述原理，采用來描述，以下是部分源程序： ()( ) 時鐘上升沿觸發(fā); 開始累加 ; ;( );? 累加結(jié)果的高位作為查找表的地址位_:_ 調(diào)用查找表 控制模塊設(shè)計部分的系統(tǒng)控制是根據(jù)所需要的功能（如相位調(diào)制、幅度調(diào)制等）要求而設(shè)計的，這一點也是利用了的靈活性。其部分程序如下：    調(diào)用主模塊 ; : ;內(nèi)部信號定義 :_; :_( );?_: 調(diào)用主模塊 (, ,); 連接內(nèi)部端口 ()? ? 系統(tǒng)時鐘的上升沿觸發(fā); ; 結(jié)論本系統(tǒng)在頻率不高于時能產(chǎn)生精確的正弦波形，而且十分穩(wěn)定。由于基準(zhǔn)時鐘為，且分辨率為位，因此，該系統(tǒng)能產(chǎn)生的最低頻率為，若要產(chǎn)生更低頻率及更精確的波形，可以提高分辨率并相應(yīng)減小基準(zhǔn)時鐘，這在中實現(xiàn)起來相當(dāng)容易。實踐證明：用設(shè)計電路較采用專用芯片更為靈活。因為，只要改變中的數(shù)據(jù)，就可以產(chǎn)生任意波形，因而具有相當(dāng)大的靈活性。相比之下：的功能完全取決于設(shè)計需求，可以復(fù)雜也可以簡單，而且芯片還支持在系統(tǒng)現(xiàn)場升級，雖