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文檔簡介

掌握流水方式下，通過I/OI/OI/O地址空間，作為數據存取空間的一部分，實現CPU與外部設備的輸入輸出端口設計。實驗中可采用高端地址。I/OlwDE2實驗板上的按鍵等輸入設備信息。即將外部設備狀態，讀到CPU內部寄存器。I/OswDE2LED燈等輸出設備的控制信號（或數據信息。即將對外部設備的控制數據，從CPU內部的寄存器，寫入到外LED7LED數碼管顯示出來。1:結構結構發生在一個結構使用時，例如同時對一個只有一個讀端口的器進行兩次，但是由于我們這里使用的是哈佛結構，即將數據器與指令器分開的結構，這里并不會發生結構。控制控制是指為了預取正確指令而導致的。我們通過提前在ID級判斷分支是否發數據有些情況下，由于分支比較需要的數據可能在之后產生，會發生數據，例如前一數據是指當一條指令試圖一個寄存器的值，而這個寄存器的值取決于前面未完成指令的執行結果的時候發生的，可以通過轉發或阻塞解決，一般采用轉發，例如在EE計算結果得出后轉發至下一條指令的EE階段，直換寄存器堆中讀出的值，來解決這條指令與上一條ALU指令的依賴；若無法轉發，例如W，在MEM階段才能得到結果，則進行一次阻塞，通過鎖存IF階段與I階段，將兩者的所有值置為零，來錯誤數據的使用。2:1:2:IF流水段mem //fetchinstructio //selectoutthenewpcaccordingtopcsource3:IF/ID流水線寄存器對于/D流水線寄存器的處理主要在于阻塞時的鎖存操作，即在ci為假時不進行輸出更新，使這個指令停頓一個周期，并在復位鍵按下時進行復位操作，即將+4的值與4:ID流水段;;當寫回寄存器信號為，且寫回數據是數據中讀出的，即是W指令。且EE階的目的寄存器（上一條指令的目的寄存器）并非零寄存器，因為零寄存器不能修改，始終pci信號設為假。數據的轉發信號如下3:4:EX assignfwda[1]=ewreg&ern!=0&ern==rs5:MEMrs)rt) mux4x32forwardda(qa,ealu,malu,mmo,fwda,da) mux4x32forwarddb(qb,ealu,malu,mmo,fwdb,db)這三個流水線寄存器僅作為一段流水線后的器，沒有鎖存等功能，實現較為 mux2x32alub(eb,eimm,ealuimm,alub) //selectthetwoinputto //calculatWB流水段的主要部件只有一個多路選擇器，wwreg信號可以選擇直接轉發至regfile，6: 9:8d0a0000%(24$10,0($8# A:214a0000%(28$10,$10 #7:LW后接ADDI這一次的實驗主要目

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