1、課后答案網www. khdaw. com課后答案網www. khdaw. com第一章數字邏輯習題1.1數字電路與數字信號1.1.2 圖形代表的二進制數0101101001. 1. 4 一倜期性數字波形如圖題所示，試計算：(1)周期：(2)頻率：(3)占空比例MSB_ LSB0121112 (ms)解：因為圖題所示為周期性數字波，所以兩個相鄰的上升沿之間持續的時間為周期，T=10ms 頻率為周期的倒數，fl/T=l/0.01s=100HZ占空比為高電平脈沖寬度與周期的百分比，q=lms/10nis*100%=l0%12數制1.2.2將卜列I進制數轉換為一進制數，八進制數和I八進制數(耍求轉換漢

2、星不人F2"(2) 127 (4) 2.718解：(2) (127) D-27-l- (10000000) B-l- (1111111) B- (177) O- (7F) H(4) (2.718) D=( 10.1011 )B=(2.54)O=(2.B)H14二進制代碼1.4.1將下列十進制數轉換為8421 BCD碼：(1) 43(3) 254.25解：(43) D= (01000011) BCD1.4.3試用十六進制寫書卜列字符繁榮ASCII碼的表示:P28(1) +(2) (3) you (4)43解：首先資出每個字符所對應的二進制表示的ASC II碼，然后將二進制碼轉換為十六進

3、制 數表示。(1) “+” 的 ASCII 碼0101011,則(00101011) B- (2B) H(2) 的 ASCII 碼為 1000000,(01000000)B-(40)H(3) yoii 的 ASCII 碼為本 1111001.1101111,UlOlOU'lhX的十六進制數分別為 79.6F.75(4) 43的ASCII碼為0110100,0110011,對應的十六緊張數分別為34,3316邏輯函數及其表示方法161在圖題1.6.1中,已知輸入信號A, B'的波形,畫出各門電路輸出L的波形。B JI_解：（a）為與非，（b）為同或非.即異或課后答案網www. k

4、hdaw. com第二章邏輯代數習題解答2. L1用真值表證明下列恒尊式(3) A®B = 'AB+AB (A®B)二ABAB解：真值表如FABAABAB44B+AB0001011011000010100001100111由最右邊2欄可知，A®B與AB +AB的真值衷完全相同。2. 1.3用邏輯代數定律證明下列尊式(3) A + ABC + ACD + (C + D)E = A + CD + E解：A + A BC + ACD + (C + D)E= A(1+BC)+ACD + CDE= A + ACD-CDE=A+CD+CDE2.1.4用代數法化簡下列各

5、式(3) ABC(B + C)解：ABC(B + C)= (A + B + C)(B + C)= AB+AC+BB + BC-CB + C=AB + C(A + B + 3 +1)= AB + C(刁 + B) + (A+ 3) + (AB)(AB) 解：(4 + B) + (A+5) + (AB)(AB)=AB+ A B + (A+ B)(A + B)= b+ab+7b= 48 +萬=A+B=AB(9) ABCD + ABD + BCD + ABCBD + BC解：ABCD + ABD+BC萬+ABCBD+/W=ABC(D + D) + ABD + BC(D + C)= B(AC+AD +

6、C+D)=BA + C + A + D)=B(A + C + D)= ab+bW+b!52.1.7畫出實現下列邏輯表達式的邏輯電路圖，限使用非門和二輸入與非門(1) L=AB+ACL = D(A + C)課后答案網www. khdaw. com課后答案網www. khdaw. comAC(2) 厶=(A + B)(C+D)AB:D2. 2.2已知函數L (A, B, C, D)的卡諾圖如圖所示，試寫出函數L的最簡與或表達式解:L(A, B、C.D) = BCD + BCD + BCD + ABD2.2.3用卡諾圖化簡下列個式(1) ABCD + ABCD + AB + AD ABC解：ABCD

7、ABCD AB+ADABC=ABCD + ABCD + AB(C + C)(D + 萬)+ 4 萬(B + B)(C + C)+ A 云C(D + 萬)=ABCD + ABCD + ABCD + ABCD + ABCD + ABCD + ABCD(6) L(A5CD)=工加(0.2、4.6、9、13) + 工J(L3,5,7,11,15)'>r:(7)厶(AB、C.D) =工7(013J4J5)+工d(123910l)解：L=AD+ACAB2. 2.4已知邏輯函數L=AB+BC + CA9試用真值表卡諾圖和邏輯圖（限用非門和與非門）表示解：1由邏輯丙數寫出貞值表ABcL00000

8、0110101011110011011110111102 由氏值表iwi出卡諾圖3山K諾圖，得邏輯農達式L=AB-BC+AC 用摩根定理將與或化為與非表達式 l=ab+bc+ac=Tbcac4由己知函數的與非-與非表達式畫出邏輯圖第三章習題3.1 MOS邏輯門電路3.1.1根據表題3.1.1所列的三種邏輯門電路的技術參數，試選擇一種最介適工作在高噪聲 壞境卜的門電路。表題3丄1邏輯門電路的技術參數表Voi/VVui/VVuw/V邏輯門A2.40.420.8邏紺門B0.6邏輯門C0.8解:根據表題3.1.1所示邏輯門的參數,以及式(3.1.1)和式(3丄2),

9、計算出邏輯門A的 高電平和低電平噪聲容限分別為：Vnha = Vow啊一=2.4V2V=0.4VV(vu(x»)= Vttgy Voi-ipat) =0.8V0.4V=0.4V同理分別求出邏輯門E和C的噪聲容限分別為：V-1VVmm =0.4VVvM=1VVvu-0.6V電路的噪聲容限愈人，其抗干擾能力愈強，綜介考渥選擇邏轎門C3.1.3根據表題3.1.3所列的三種門電路的技術參數，計算出它們的延時功耗積,并確定哪一種 邏輯門性能最好表題3丄3邏輯門電路的技術參數表tpLH/nstfHL/nsPohnW邏紺門A11.216邏輯門B568邏wnc10101解涎時功耗積為傳輸延氏時間與功

10、耗的乘積，即DP= IxPd根據上式可以計算出各邏輯門的延時-功耗分別為tpui 4- tpHi.(1+1.2)"S 亠亠.DP、= Pd= 16mw=17.6* 10 u J=17.6PJ2 2同理得出：DPr =44PJ DP< =10PJ,邏輯門的DP值愈小，表明它的特性愈好，所以邏輯門C的 性能最好.3.1.5為什么說74HC系列CMOS與卄:門在+5V電源工作時，輸入端在以卜四種接法卜邯屈 于邏輯0: (1)輸入端接地；(2)輸入端接低于1.5V的電源；(3)輸入端接同類與非門的輸 出低電壓0.1V; (4)輸入端接10kQ的電阻到地.解:對J； 74HC系列CMOS

11、門電路來說，輸出和輸入低電平的標準電壓值為:Kt=0.1V； W-1.5V；因此冇：(1) W=o< %=1.5乂屈邏輯門 0(2) vi.5V=Vk,屬于邏輯門0(3) W<0.1<Vk-1.5Y屬于邏輯門 0(4) 由J CMOS管的柵極電流IF常小.通常小J' 1UA,在10kQ電阻上產生的壓降小J; 10mV即V/<0.01V<V/t=1.5V；故亦屬 J：邏輯 求圖題3.1.7所小電路的輸出邏軻衣達式.解:圖解3.1.7所示電路中L1麗,L2BC丄3DJL4實現與功能，即L4-L1 L2 L3,ffiL=U£所以輸出邏輯表

12、達式為L=AB EC DE3.1.9圖題3.1.9表示三態門作總線傳輸的示意圖，圖中n個三態門的輸出接到數據傳輸總 線,DI, D2,Dn為數據輸入端，CSL CS2CSn為片選信'，；輸入端.試問：(1)CS信號如何進行控制，以便數據D1.D2,Dn通過該總線進行正常傳輸；(2)CS信號能 否仃兩個或兩個以上同時仃效?如果出現兩個或兩個以上仃效，可能發生什么請況。(3)如呆 所有CS信號均無效,總線處在什么狀態？DnCSnD2CS2DICS1解：根據圖解3.1.9町知，片選信號CS1, CS2CSn為高電W響效，當CSi=l時第1個三 態門被選屮，其輸入數據被送到數據傳輸總線上，根據

13、數據傳輸的速度，分時地給CS1, CS2CSn端以正脈沖信號使K相皿的二態門的輸出數據能分時地到達總線上.(2) CS信號不能仃兩個或兩個以上同時仃效，否則兩個不同的信巧將金總線I發丫沖突即總 線不能同時既為0又為1.(3) 如果所有CS信號均無效,總線處J 高阻狀態.3.1.12 試分析3.1.12所示的CMOS電路說明它們的邏輯功能X7AVI 7;士c)一EH仏L 咒 幾遷 卅>1TG解：対圖題3.1.12(a)所示的CMOS電路，曲EN =0時，和7三均導通，和構成的反相器正常工作，L=A,當EN-1時，和工壯均截止，無論A為高電平還是 低電平，輸出端均為高阻狀態，其其值農如衣題解

14、3.1.12所示，該電路是低電平使能三態非門，其表示符號如圖題解3.1.12 (a)所示。 a 圖題3.1.12 (b)所示CMOS電路，麗=0時，導通，或非門打開，和構成反 相器正常工作,L=A；當麗=1時,7溝截止,或非門輸出低電平,使九截止，輸出端 處丁高阻狀態,該電路是低電平使能三態緩沖器,其表示符號如圖題解3.1.12 (b)所示。同理可以分析圖題3.1.12 (c)和圖題3丄12 (d)所示的CMOS電路，它們分別為高電平使能三態緩沖器和低電平使能三態非門，其表示符號分別如圖題3.1.12 (c)和圖題 3.1.12 (d)所示。EN'AL00101010高阻113.1.1

15、2 (a)麗.AL0000113.2.2為什么說TTL與非門的輸入端在以卜四種接法卜，都屈邏輯1： (1)輸入端懸空；(2)輸入端接高J：2V的電源；(3)輸入端接同類與非門的輸出高電斥3.6V； (4)輸入端 接10kQ的電阻到地。解：(1)參見教材圖3.2.4電路，當輸入端懸空時，T】管的集電結處正偏，Vcc作用口 的集電結和T2 , T3管的發射結，使T2 , T3飽和，使D管的集電極電位 Vc2=Vces2+Vbe3=O.2+O.7=O.9V,而 口 管若要導通 Vb2=Vc2>VbE4+Vd=0.7+0.7=1 4V,故 T4 截止。乂WT3飽和導通，故與非門輸出為低電平，由上

16、分析，與非門輸入懸空時相當輸 入邏輯1 O(2) 當與IF門輸入端接S J - 2V的電源時，若管的發射結導通，則Vbei>0.5V,管的 基極電位Vb>2+ Ci=2.5Vo而Vbi>2.1V時，將會使1的集電結處于正僞,Tz, Ts處于飽 和狀態,使T4截止,與非門輸出為低電平。故與非門輸出端接高于2V的電源時,相當J： 輸入邏輯仁(3) 與非門的輸入端接同類與非門的輸出高電平3.6V輸出時，若T】管導通，則 Vbi=3.6+0.5=4.1o而若VBO2.W時，將使的集電結正偏.T2, T3處飽和狀態，這時 VB1®鉗位在2.4V,即Ti的發射結不可能處J：導通

17、狀態，而是處反偏截止。由(1) (2), 當Vbi>2.1V,與非門輸出為低電平。(4) 與非門輸入端接10kQ的電阻到地時,教材圖3.2.8的與非門輸入端相當F解3.2.2圖所示。這時輸入電壓為 Vi= RI+Rb (Vcc-Vbe)=10 (5-0.7) / (10+4)二3.07V。若 Ti 導通,則 Vbi-3.07+ Vbe=3.07+0.5=3.57 V.但 Vbi 是個不可能大于 2.1V 的。當 Vbi-2.1V 時,將使 Ti管的集電結正偏,T2, T3處于飽和,使Vbi被鉗位在2.1V, W此,Rl=10kQ時，T1 將處V截止狀態，由(1 )這時相當J：輸入端輸入高

18、電平。+ Vcc3.2.3 設冇一個74LS04反相器驅動兩個74ALS04反相器和四個74LS04反相器.(1)問 驅動門是否超我？ (2)若超我，試提出一改進方案：若未超載，問還可增加兒個74LS04 門？解:(1)根據題意,74LS04為驅動門，同時它有時負載門,負載門中還有74LS04。 從主教材附錄A査出74LS04和74ALS04的參數如卜(不考虔符號)74LS0-4: Ioi.(xn3x)=8niA, Ion (max丿=0.4niA' /in (max) =0.02niA.4 個 74LS04 的輸入電流為：4 Ll) =4 X 0.4niA= 1.6mA,4=4 x

19、0.02niA=0.08mA2 個 74ALS04 的輸入電流為：2 Ll) =2 x 0.1mA=0.2niA.2 Iih (max) =2 x 0.02111A=O.04niA,® 拉d流施我情況卜如圖題解323 (a)所示，74LS04總麻拉電流舜兩部分，即4個 74ALS04的高電平輸入電流的繪人值4 Iih)=0.08mA電流Z和為 0.08uiA+0.04inA=0.12uiA.iflj 74LS04 能提供 0.4111A 的拉電流，并不超戟。糠電流負我潔況如圖題解3.2.3 (b)所示，騾動門的總漂電流為1.6mA+0.2mA-1.8mA. ifU 74LS04能提供

20、8mA的灌電流，也未超載。(2)從匕面分祜計可可知，74LS04所驅動的兩朵負載無論扁灌電流還是拉電流藥茶超'3.2.4圖題3.2.4所爪為集電極門74LS03騾動5個CMOS邏輯門，C知OC門輸管截止時的漏電流7.2mA：負我門的參數為：=4V,=1V1A試計算上拉電阻的值。課后答案網www. khdaw. com從主教材附錄 A 查得 74LS03 的參數為：VoH(nun) =2.7V, Vozgax丿=05V. /oMm«)=8mA.tl4據 式(3.1.6)形式(3.1.7)可以計算出上拉電阻的值。灌電流情況如圖題解3.2.4 (a)所示，74LS03 輸 出為低

21、電平，/心沏ao =5 Iil =5 * 0.001mA=0.005mA.有n VdD VoL(max.) (5 4)VRpT =m 0.56K QIoL(nx) - IlL(total) (8 0005)4拉電流情況如圖題解324 (b)所示，74LS03輸出為高電平,ItH(Mai)=5 Iih =5 x 0.001uiA=0.005mAVoD-VOHnnn)(5-4)V由J；為保證負載:門的輸入高電平，取VoH(xnin) =4V冇Rg 厶-4.9K QIoL(totat) + llHgal) (0.2 - 0.005)/7/4綜上所述，心的取值范I荊為056G49G3.6.7設計一發光

22、:極管(LED哪動電路.設LED的參數為匕=2.5V, /0=4.5Ma;/*,: Va =5V；當 LED發殼時，電路的輸出為低電平，選出集成門電路的型汛并畫出電路圖.解：設驅動電路如圖題解3.6.7所示，選用74LSO4作為驅動器件，它的輸出低電平電流VoiW=0.5V,電路中的限流電阻總 444Q(5-2.5-0.5)vR=Id45l4VI課后答案網www. khdaw. com第四章組合邏輯習題解答4. 1. 2組介邏輯電路及輸入波形(A.B)如圖題4.1.2所示，試寫出輸出端的邏輯表達式 并訓出輸出波形。課后答案網www. khdaw. com課后答案網www. khdaw. com

23、解：由邏輯電路寫出邏輯表達式L=A+AB=A2B首先將輸入波形分段，然后逐段畫出輸出波形。當A.B信號相同時，輸出為1.不同時，輸出為0.得到輸出波形。nrLTLJ-如圖所示4. 2. 1試用2輸入與非門設計一個3輸入的組介邏輯電路。當輸入的二進制碼小J： 3時, 輸出為0:輸入人于等于3時，輸出為1。解： 根據組介邏輯的設計過程，n先耍確定輸入輸出變駅，列出真值表。由卡諾圖化簡 得到最簡與或式，然后根據要求対表達式進行變換，畫出邏輯圖1)設入變磺為A. B.C輸出變啟為L,根據題意列真值表BCL000000100100011110011011110111112)山匸諾圖化簡，經過變換紂到邏輯

24、農達式L111 1BL=A+BC=ABC3）用2輸入與卑門實現上述邏輯衷達式4. 2. 7 某足球評委會山-位教練和三位球迷組成.對裁判員的判罰進行表決。當滿足以 卜條件時表示同意：冇三人或三人以上同意，或若有兩人同意，但其中一人是叫教練。試用 2輸入與非門設計該表決電路。解：1）設一位教練和三位球迷分別丿I】A和B.C.D表示，并IL這些輸入變磺為1時衣示同 意，為0時表示不同意，輸出L衷示表決結果。L為1時表示同意判罰，為0時衷示不同意。 由此列出真值表輸入輸出ABCDL000000001000100001100100001010011000111110000100111010110111

25、110011101111101111112）由真值表畫卡諾圖課后答案網www. khdaw. com由卡諾圖化簡得L二AB+AC-AD+BCD由規定只能用2輸入與非門，將上式變換為兩變駅的與非一與非運算式L= *AD*5CD =3）根據L的邏輯表達式畫出由2輸入與非門組成的邏輯電路4. 3. 3判斷圖所示電路在什么條件卜產生竟爭冒險，怎樣修改電路能消除竟爭冒險?解：根據電路圖寫出邏輯農達式并化簡那厶=AB+BC當A二0. C二1時，L = +B有可能產牛競爭冒險.為消除可能產牛的競爭冒險,增加乘積項使朮，使L = AB + BC + AC,修改后的電路如圖課后答案網www. khdaw. co

26、m4. 4.4試用71HC147設計鍵盤編碼電路，十個按鍵分別對應|進制數09.編碼器的輸出 為8121BCD碼耍求按鍵9的優先級別域高，并且仃丁作狀態標志，以說明沒仃按鍵按卜和 按鍵0按下兩種情況。解：真值表1111.1111100000XXXXXXXXX010Q11XXXXXXXX0110001XXXXXXX01101111x-!XXXXX011101101xXXXX0111101011xX XX0111 1101001.XX011111100111xx011111110101X01111111100011011 1fr111 .1QQQQ1A B C D GS電路圖B4.4.6川譯碼器7

27、4HC138和適當的邏軌門實現函數F-. ABCfABCWCmC解：將函數式變換為垠小項Z和的形式F= ABC+ABC+ABC+ABC = Pio +rTU +m5 +rTh課后答案網www. khdaw. com將輸入變量A.B. C分別接入AZ Al. Ao端,并將使能端接有效電平。由f 74HC138 是低電平有效輸出，所以將般小項變換為反函數的形式課后答案網www. khdaw. com課后答案網www. khdaw. com在譯碼器的輸出端加一個與非門，實現給定的組合函數。Eg EsYoEiY.Ye74HC138YiY4Ys人0YeIY?A2+ 5Vro& yr課后答案網ww

28、w. khdaw. com課后答案網www. khdaw. com4.4.14七段顯示譯碼電路如圖題4. 4. 14 (a)所示，對應圖題4. 4, 14 (b)所示輸人波 形，試確定顯示器顯示的字符序列解：當LE=O時，圖題4, 4。14 (a)所示譯碼器能正常匸作。所顯示的字符即為A2A2A1A 所表示的十進制數，顯示的字符序列為0、1、6、9、4。當LE由0跳變1時,數字4被鎖 存，所以持續顯示4。4. 4. 19試用4選1數據選擇器74HC153產生邏輯函數厶C)=工7(126,7). 解：71HC153的功能表如教材中表解4. 4. 19所示。根據表達式列出真值表如下。 將變量A、B

29、分別接入地址選擇輸入端,、S。，變量C接入輸入端。從表屮可以 看岀輸出L與變帚C之間的關系，當AB=OO時,L=C,因此數據端人接C：當AB=01 時，L二C,人接C；當AB為10和11時，L分別為0和1,數據輸入端人和人分別接0和1。由此可得邏輯函數產生器，如圖解4. 4. 19所示。輸入輸出ABcL0000L=C00110101L = C01101000010101101111114. 4. 21應用74HC151實現如下邏輯函數。E51521312II101/2 74HC153圖解44 19解：1. F = ABC + ABC = mA + m5 4- mlD1=D4=D5=1,其他=0

30、2.Y =4OflOC = (4B+4B)OC=AB+ABC + (AB AB)C =(AB +A B)C +ABC ABC =AfiC+A BC+ABC + 肋C=m, + zn2 + m4 + m7 .0。=。3 =D5 =D6 =0 D =D2 =D4 =D7 =10c匚:匚Y74HC151LCiABCiABCY74HC151Y艸®B)©C(a)(b)4, 4. 26試用數值比較器74HC85設計_個8421BCD碼有效性測試電路,當輸人 為8421BCD碼時，輸出為1,否則為0。解：測試電路如圖題解44. 26所示，當輸人的08421BCD碼小于1010時，FA V

31、B輸出為1,否則0為0。14. 4. 31由4位數加法器74HC283構成的邏輯電路如圖題4。4. 31所示，M和 N為控制端，試分析該電路的功能。解：分析圖題44, 31所示電路，根據MN的不同取值，確定加法器74HC283 的輸入端B3B2B1B0的值。當MN=00時，加法器74HC283的輸人端B3B2B1BO= 0000,則加法器的輸出為S = Io當MN=01時，輸入端B3B2BlB0=0010,加法器 的輸出S = I + 2。同理，可分析其他情況，如表題解4. 4. 31所示。MM4.4. 31NBy爲£嘰SMN叭%S000000/0100011八3010010八211

32、0101八5該電路為町控制的加法電路。NM第六章習題答案6.1.6 e知某時序電路的狀態表如表題6. 1, 6所示，輸人為A,試畫出它的狀態圖.如果 電路的初始狀態在b,輸人信號A依次是0、1、0、1、1. K b試求其相丿衛的輸出。«H6.1.6現杰(S)次態/輸出(S"'/Z)A x0aa/06/0ba/Id/1c6/1e/1dd/0c/0e6/1a/1解：根據衣題6。1. 6所示的狀態衷，可直接畫出與英對應的狀態圖，如圖題解61。6 (a) 所示。當從初態b開始，依次輸人0、1、0、1、1、1、1信號時，該時序電路將按圖題解6.1. 6 (b)所示的順序改變狀

33、態，I大I而其相W的輸出為1、0、1、0、K 0、lo(a)1/0621試分析圖題6。2. 1 (a)所示時序電路，畫出具狀態農和狀態圖。役電路的初始狀態 為0.試畫出在圖題6. 2. 1 (b)所示波形作用下，Q和z的波形圖。亙Q(a)(a)-JTTLTLrLriJTriJTrLLJ l_CP_rLTLnTLnTLn_rLrLLJLJ圖題62. 1解：狀態方程和輸出方程：Q1 =4e Q"ZAQ才 jirLruiTLnTLrLTL ，-ULJq ii rn z uLJ(b)圖題解62. 1624分析圖題6. 2o 4所示電路，寫出它的激勵方程組、狀態方程組和輸出方程，畫出狀 態表和

34、狀態圖。解：激勵方程Jo = Q) Kq 二 A Q、JI = (2o K 1狀態方程輸出方程Z=AQ1QO根據狀態方程組和輸出方程可列出狀態表,如表題解6. 2. 4所示,狀態圖如圖題解6。2. 4 所示。圖題解62.4625分析圖題6. 2. 5所示同步時序電路，寫出各觸發器的激勵方程、電路的狀態方程組 和輸出方程，畫出狀態表和狀態圖。圖題6. 2.5解：激勵方程人=人Kq = AQtJi "QoK人k2=i狀態方程_Q； “理;O；代；詡（Q；+S）Q："W+4Q：S"（Q；+0：）輸出方程z=aq2根據狀態方程組和輸出方程列出該電路的狀態表，如表題解6,

35、2, 5所示，狀態圖如圖題解"6 3.16。2. 5所示。囊 SI 解 6. 2.5Q；Q；Q：Q；'Q；y'/zQ；Q；SQ；yA =04=1A s 0A =1000000/0001/0100000/1001/0001000/0010/0101000/1010/0010000/0011/0110000/1011/0011100/0011/0111000/1011/0Q；Q；Q：“Q：'/yA « 0A =10001/011/00110/000/01011/001/01100/110/16.3.1用JK觸發器設計一個同步時序電路，狀態表如卜解：所耍設

36、計的電路仃4個狀態，需要用兩個JK觸發器實現。(1) 列狀態轉換真值表和激勵表由表題6。3. 1所示的狀態衣和JK觸發器的激勵農，對列出狀態轉換典值農和對各觸發器 的激勵信號，如表題解6. 3o 1所示。哀解6. 3.1Q：Q；aQ： ©*Y7.KAK。0 0 00 100X1X0 0 11 101X1X0 1 01 1XX10 1 10 00 xX11 0 01 10X11X1 0 10 10X11X1 1 00 01X1X11 1 11 01X0X1(2) 求激勵方程組和輸出方程由表題解63. 1畫出各觸發器J、K端和電路輸出端y的卡諾圖,如圖題解6. 3. 1 (a) 所示。從

37、而，得到化簡的激勵方程組J | = K = © Qq輸出方程Y=Q1QOQ1QOA(a)山輸出方程和激勵方程話電路(b)圖題解6.3. 16.3.4試用卜降沿出發的D觸發器設計一同步時序電路.狀態圖如634 (a) , SOS1S2的編 碼如 6.3.4 (a)解：圖題63。4 (b)以卡諾圖方式表達出所要求的狀態編碼方案，即S0=00. Si=01, S2=10, S3為無效狀態。電路礙要兩個卜降沿觸發的D觸發器實現，設兩個觸發器的輸出 為Q0,輸人信號為A,輸出信號為Y圖題63.4(1) 由狀態圖可直接列出狀態轉換真值表,如農題解6。3. 4所示。無效狀態的次態可用 無關項X表示

38、。(2) 畫岀激勵信號和輸出信號的卡諾圖。根據D觸發器的特性方程，可由狀態轉換真值表肖接畫出2個卡諾圖，如圖題解6. 3。4 (a)所示。丨表通解6.3.4'Q；Q；AQ；“(6)礦(0。)Y00000000101001010001101010000010100111XXX111XXX(3)由卡諾圖得激勵方程D| "QoDo = g輸出方程Y=AQ1(4) 根據激勵方程組和輸出方程畫出邏輯電路圖，如圖題解6. 3. 4 (b)所示。(5) 檢査電路是否能門啟動。由D觸發器的特性方程Q'-1=D,可得圖題解6. 3, 4(b) 所示電路的狀態方程組為輸JH Y=lo如圖

39、(c)(b)田題解63.4代入無效狀態11,可得次態為00,6.5.1試畫出圖題65.1所示電路的輸出(Q3 Q0)波形，分析電路的邏輯功能。CLK 0111圖題65. 1解:74HC194功能由S1S0控制00保持.01右移10左移11并行輸入當啟動信號端輸人一低電平時，使Sl=b這時有S。=Sl=b移位寄存器74HC194執行并 行輸人功能,Q3Q2Q1QO=D3D2D1DO=111O.啟動信號撤消后,由于Q。=0,經兩級與 非門后,使S1-0,這時有S1SO=O1,寄存器開始執行右移操作。在移位過程中,因為Q3Q2、 QI、Q0屮總仃一個為0,因而能夠維持S1S0-01狀態，使右移操作持

40、續進行下去。其移位 情況如圖題解6, 5, 1所示。由圖題解65。1可知,該電路能按固定的時序輸出低電平脈沖,是一個四相時序脈沖產生 電路。12345cpJl/l/LTLTLQI00Q、6.5.6試用上升沿觸發的D觸發器及門電路組成3位同步二進制加1計數器：畫出邏輯圖 解：3位一.進制計數器需要用3個觸發器。因足同步計數器，故各觸發器的CP端接同一時 鐘脈沖源。(1) 列出該計數器的狀態表和激勵表，如表題解6.5.6所示'衰題解6. 5.6計數脈沖CP的順序現態次態%激勵信號Q；Q；Q；QV1Q；QJ'0D。00000010011001010010201001101130111

41、00100410010110151011101106110 一1111117111000000(2) 用尺諾圖化簡,得激勵方程= Q2(QQo)(3) 畫出電路02000Qt00A、1 Nl110fi0(11r>0(1a00I1 1;"00+111Qo0000CP圖題解.10用JK觸發器設計一個同步六進制加1計數器 解：需耍3個觸發器(1)狀態表，激勵表計數脈沖CP的順序現Q；態QV'次態Q：激勵信號Q；Q；A&土00000010X0X1X10010100X1XX120100110XX01X30111001XX1X14100101X00X1X51

42、01000X10XX1110XXXXXXXXX111XXXXXXXXX衰解65.10(2)用卡諾圖化簡得激勵方程小Jf1心k =Q°I(a)(b)圖越無6.5.10(3) 檢査向啟動能力。當計數器進入無效狀態110時.在CP脈沖作用卜，電路的狀態將按110-111 f000變化.計數器能夠自啟動。6.5.15試用74HCT161設計一個計數器，Jt計數狀態為門然二進制數10011111。解：由設計要求可知，74HCT161在計數過程中要跳過00001000九個狀態而保1001 1111 t個狀態。因此，町用“反饋吊嗷法”實現：令74HCT161的數據輸人端D3D2D1D0 = 100

43、1,并將進位信號TC經反和器反相后加至并彳亍置數使能端上。所設汁的電路如圖題解 6o 5. 15所示。161為異步清零，同步置數。課后答案網www. khdaw. comCR Do D, 6 D3 getTCCPCEP 74HCT161>CPPEQ。Qi Q Q,圖題解6.5. 156.5.18試分析電路，說明電路是幾進制計數器解：兩片74HCT161級聯厲，最多可能冇162 = 256個不同的狀態。而用“反饋置數法”構 成的圖題65。18所示電路中,數據輸人端所加的數據01010010,它所對應的十進制數是 82,說明該電路心置數以后從01010010態開始計數，跳過了 82個狀態。因此，該計數器的 模M-255-82 = 174,即-百七十四進制計數器。ZPoo06.5.19試用74HCT161構成同步二十四一制計數器，要求采用兩種不同得方法。解：因為M=24,仃16VMV256,所以耍用兩片74HCT16K將兩芯片的CP端直接與計數 脈沖相連，構成同步電路,并將低位芯片的進位信號連到高位芯片的計數使能端。用“反饋 清零法”或“反饋置數法”跳過256-24=232個多余狀態.反饋清零法：利用74HCT161的“異步淸零”功能，在第24個