1、第七章 可編程邏輯器件 PLD Programmable Logic Device7.1 PLD 概述 7.1.1 PLD 的電路結構及分類PLD 的基本結構 P0Pm-1 I0 In-1 O0 Ob-1N 個輸入b 個輸出m個乘積項與陣列或陣列7.1.1 PLD的電路結構及的分類組合PLD時序PLD只讀存儲器(ROM)可編程邏輯陣列(PLA)可編程陣列邏輯(PAL)通用邏輯陣列(GAL)根據輸出是否包含寄存器分為根據內部結構及編程方式分為PLD的分類只讀存儲器 (ROM) ： 與陣列固定 或陣列可編程可編程邏輯陣列 (PLA) ： 與陣列可編程 或陣列可編程可編程陣列邏輯 (PAL) ： 與

2、陣列可編程 或陣列固定7.1.2 PLD 的編程工藝及描述的邏輯規則和符號一、PLD 的編程工藝 1.掩膜可編程PLD（mask PLD ) 2.現場可編程PLD：PPLD (可編程PLD) EPPLD (可擦除可編程PLD) EEPPLD (電可擦除可編程PLD)二、PLD 的描述規則和符號7.1.3 PLD 的設計過程及主要優點一、的設計過程 所需設備：兩大類可編程邏輯開發軟件 編程器設計過程分三個階段：、設計輸入、設計實現、設計驗證二、的主要優點、簡化系統設計、功能集成度高、可靠性高7.2 只讀存儲器 Read Only Memory只讀存儲器按內部結構可分為：固定只讀存儲器ROM可編程

3、只讀存儲器PROM可擦除可編程只讀存儲器EPROM電可擦除可編程只讀存儲器 EEPROM特點：與陣列固定 或陣列可編程7.3 可編程邏輯陣列 (PLA) Programmable Logic Array特點：與、或陣列都可編程 1. 針對邏輯函數的最簡與或式PLA中的與陣列被編程產生所需的全部與項PLA中的或陣列被編程完成相應與項間的或運算 并產生輸出。邏輯功能越復雜，其優點越明顯。這樣，就大大提高了芯片面積的有效利用率。 2. PLA分組合PLA和時序PLA(包含有觸發器)。7.4 可編程陣列邏輯 (PAL) Programmable Array Logic特點：固定的或陣列和可編程的與陣列

4、 與同樣位數的PLA相比，PAL不但減少了編程點數(或陣列固定)，而且也簡化了編程工作(僅對與陣列編程，工作單一)。 這樣，就更有利于輔助設計系統的開發。7.4.1 組合 PAL 器件組合PAL 的基本結構框圖輸入I0I(n-1)nO0O(s-1)slkP0 P(k-1)O 輸出IO 輸出IO0IO(l-1)l 與陣列(可編程) 或陣列（固定）7.4.2 時序 PAL 器件時序PAL 的基本結構框圖X 0 X(n-1)O0 O(l -1)slkP0 P(k-1)IO 輸出寄存器輸出O0 O(l -1)IO0 IO(s-1)llOEs輸入n輸出寄存器組CLK 或陣列（固定） 與陣列(可編程)7.5 通用邏輯陣列概述(GAL)Generic Array Logic一、工藝上的改進 高速電可擦除CMOS(Electrically Erasable Comple-mentary Metal-Oxide Semiconductor (E2CMOS)特點： 可測試性 低功耗，使集成度更高 速度不低于其他TTL可編程器件 可重復編程100次衣裳7.5 通用邏輯陣列概述(GAL)Generic A